- •Московская государственная академия приборостроения и информатики
- •Содержание
- •1. Понятие архитектуры процессора и элементная база
- •1.1 Понятие архитектуры эвм и архитектуры процессора
- •1.2 Элементная база (физическая база) процессора
- •1.3 Пути совершенствования элементной базы
- •1.3.1 Молекулярные компьютеры.
- •1.3.2 Биокомпьютеры или нейрокомпьютеры.
- •1.3.4 Оптические компьютеры
- •2. Процессоры с классической архитектурой
- •2.1. Основные принципы классической архитектуры:
- •1.3.3 Квантовые компьютеры
- •2.2 Организация памяти в классической архитектуре
- •2.3 Набор команд фон - Неймановского процессора
- •2.4 Обработка особых ситуаций и прерывания
- •3. Стековые процессоры
- •3.1 Этапы выполнения команды в фон Неймановском процессоре
- •3.2 Архитектурные особенности стекового процессора
- •3.3 Операции с оперативной памятью
- •3.4 Программирование на стековом процессоре
- •3.5 Замечания по реализации
- •4. Конвейерные процессоры
- •4.1 Предпосылки создания конвейера данных
- •4.2 Структура конвейера данных
- •4.3 Сокращение времени при использовании конвейера данных
- •4.4 Конвейер команд
- •4.5 Многооперационные конвейеры
- •4.6 Проблемы конвейерных процессоров:
- •4.7 Особенности программирования конвейерных процессоров.
- •4.8 Замечания по реализации
- •5. Cray - процессор
- •5.3.2 Регистровый трёхадресный ассемблер
- •5.3.3 Регистровая буферизация и «прозрачная память»
- •5.3.4 Функциональные конвейерные блоки операций
- •5.3.5 Буферизация команд
- •5.4 Общая структура и состав процессора cray.
- •5.5 Производительность и области применения
- •6. Процессор пересылок
- •6.1 Иерархия памяти в классической архитектуре
- •6.2 Организация памяти в процессоре пересылок
- •6.3 Организация процессора пересылок
- •6.3.1 Адресная фиксация схем исполнения машинных команд
- •6.3.2 Механизм запуска машинной команды
- •6.4 Пример программы в процессоре пересылок
- •6.5 Реализация перехода по адресу и сравнения
- •6.6 Замечания по реализации процессора пересылок
- •7. Архитектуры процессоров
- •7.1. Процессоры с универсальным набором команд
- •7.2Risc– процессоры
- •7.3 Теговые машины
- •7.4 Гарвардская архитектура
- •8. Подходы к организации вычислительного процесса и потоковые машины
- •8.1 Процедурное программирование.
- •8.2 Функциональное программирование
- •8.3 Потоковое программирование
- •9. Архитектуры памяти
- •9.1 Классификация архитектур памяти
- •9.2 Память с чередование адресов
- •9.3 Кэш память
- •9.4. Ассоциативная память (безадресная память)
- •10. Архитектурные решения
- •10.1 Проблемы организации и управления вводом/выводом
- •10.2 Основные архитектурные решения
- •10.3 Канальный ввод/вывод
- •10.4 Архитектура с общей шиной
- •10.5 Архитектура ввода/вывода с общей памятью
- •11. Параллельная обработка
- •11.1 Мультипрограммирование (многозадачность)
- •11.1.1 Однопроцессорная обработка
- •11.1.2 Многопроцессорная обработка
- •11.2 Параллелизм независимых ветвей
- •11.3 Параллелизм объектов
- •12. Матричные системы
- •12.1 Однородные системы - параллелизм этапов задач
- •12.2 Матрицы волнового фронта данных - параллелизм команд
- •12.3 Классические матричные системы - параллелизм объектов
- •107846, Москва, ул. Стромынка, 20
7.2Risc– процессоры
Для быстрого выполнения программы, написанной на языке высокого уровня, не нужны сложные машинные команды - гораздо более важно сократить время выполнения наиболее часто используемых команд. Этот принцип был положен в основу RISC-архитектуры, которая представляет собой улучшенный вариант неймановской архитектуры. Благодаря сокращению набора команд упрощаются аппаратные схемы, а значит, обеспечивается оптимизация выполнения часто используемых команд. Кроме того, за счет применения большого числа регистров уменьшается частота (число) доступов к памяти, что также позволяет повысить скорость выполнения команды.
Таким образом основная идея RISC процессоров – малый фиксированный набор быстрых команды позволяет не только резко сократить набор машинных команд, отметим, что сокращение до 32 команд сокращает так же до 5 битов длину кода операции, но и сократить набор схем, реализующих команды, что позволяет при той же степени интеграции СБИС увеличить количество регистров и объем кэш-памяти.
Типичные представители этих машин: компьютер RISC Калифорнийского университета в Беркли, IBM 801, MIPS Станфордского университета, μ3L Университета шт. Юта, RIDGE 32 - фирмы Midge, Pyramid 90X фирмы Pyramid и др. RISC-архитектуру имеет и транспьютер фирмы «Инмос» - 32-разрядный процессор, спроектированный с оптимальным набором команд, позволяющим использовать язык высокого уровня Оккам.
7.3 Теговые машины
Одним из факторов, усложняющих разработку программного обеспечения, является наличие большого различия между понятиями операций и ихобъектов на языке программирования высокого уровня и понятиями операций и их объектов, определяемыми архитектурой компьютера. Это отличие носит название семантического разрыва. Иначе говоря, если на языке высокого уровня можно описать различные операции и типы данных, то в неймановской архитектуре разницы между программами и данными нет, как нет и разницы между типамиданных. Это обстоятельство тяжелым бременем ложится на плечи программиста при составлении программы. И впоследствии оно является причиной усложнения отладки программы. Из-за отсутствия различий в типах данных и между программами и данными нельзя обнаружить, была ли ошибка связана с выполнением команды или с обращением к данным. Нельзя также обнаружить, выполняются ли данные в качестве команды или что к команде осуществляется обращение, как к данным.
Для решения этой проблемы Илифф предложил с помощью некоторого алгоритма добавлять ко всем данным информацию, необходимую для того, чтобы идентифицировать их как данные, использовать вместо линейного адресного пространства памяти структурированное пространство и добавлять к каждому элементу памяти информацию, показывающую атрибут этого элемента. Эта дополнительная информация получила название «тег». Машины, основанные на этом принципе, называют теговыми машинами. Так, различные типы данных характеризуютсясвоими тегами, а однотипные команды, отличающиеся только типами операндов, никак не различаются.Например, программисту нет необходимости различать командыADD(сложения) с плавающей и фиксированной запятой, как в CISCпроцессорах: машина это сделает автоматически, проверив типы операндов. В случае обращения с массивами данных добавляется такая теговая информация, как длина, ширина массива, индексы, а выход за пределы массива автоматически контролируется машиной при обращении к данным.
Майерс предложил проект SWARD - машины, в которой идеи теговых машин получили свое дальнейшее развитие.
В SWARD-машине данные представлены структурным элементом, называемым ячейкой. На рис. 7.1 приведен пример ячейки. Каждая ячейка состоит из поля тега и поля данных. Численные значения представлены в двоично-десятичном коде, и один разряд десятичного числа представлен четырьмя двоичными разрядами (битами). Память разбита на 4-разрядные единицы, которые называются признаками. Разрядность данных, указанных в поле тега, выражается числом признаков. Положительный знак числа выражается кодом 0000, отрицательный - 0001. Если используются массивы данных, то в поле тега указываются размерность массива, тип ячейки элемента массива, длина каждого измерения. Если элементом массива является целое число, то к типу ячейки после 1111 добавляется информация о длине числа. В SWARD-машине теговая информация используется не только применительно к данным, но и применительно к программным модулям.
П
редставление
данных в теговых машинах
Рис 7.1
