45)Структура микропроцессора Кр580вм80а
Микросхема КР580ВМ80А - функционально законченный однокристальный параллельный 8 разрядный микропроцессор с фиксированной системой команд применяется в качестве центрального процессора в устройствах обработки данных и управления Микропроцессор имеет раздельные 16 разрядный канал а феса и 8 разрядный канал данных Канат адреса обеспечивает прямую адресацию внешней памяти объемом до 65536 байт 256 устройств ввода и 256 устройств вывода.
Восьмиразрядное арифметико-логическое устройство микропроцессора обеспечивает выполнение арифметических и логических операций над двоичными данными представленными в дополнительном коде а также обработку двоично-десятичных упакованных чисел.
При выполнении команд микропроцессор может переходить в одно из трех состояний: «ожидание», «захват> и «останов:», длительность которых определяется внешними управляющими сигналами.
46) Алгоритм управления циклом выполнения команд управляющего автомата мп к580.
МП К580 - однокристальный, 8-ми разрядный, основан на принципе управления жесткой логики. УУ и операционная часть реализованы в одном кристалле. 6 регистров общего назначения и аккумулятор являются программно доступными, т.е. при написании программы программист может к ним обращаться. Регистры и буферные регистры являются программно недоступными, т.е. они участвуют в выполнении программы, но программист к ним обратиться не может. РОН являются 8-ми разрядными. Если операции совершаются над 16-ти разрядными операндами, то РОН объединяются попарно. Регистры указателя стека, счетчик команд и регистр адреса являются 16-ти разрядными. Указатель стека содержит номер верхней занятой ячейки стека. При записи информации в стек содержимое указателя стека уменьшается на 1, а при считывании увеличивается на 1. Счетчик команд содержит номер ячейки ОЗУ, содержащей следующую команду. При считывании из счетчика команд номера ячейки команд содержимое счетчика увелич. на 1.
Регистр адреса служит для передачи содержимого счетчика команд через шину адреса и буфер адреса в ОЗУ.
Устройство управления содержит регистр команд, дешифратор команд и управляющее устройство, в которое входит ПЛМ, содержащая управляющую память.
Управляющая память содержит микропрограммы всех 78-ми команд для данного МП. АЛУ дополняется схемой десятичной коррекции для действий над двоично-
десятичными числами.
Эта система предназначена для последовательного опроса 8-ми аналоговых датчиков и передачи информации в ОЗУ. Опрос датчиков преобразования аналоговой информации в цифровую, запись информации в ОЗУ производится под управлением МП.
47)Risc микроконтроллеры. Особенности их архитектуры и функционирования.
RISC — архитектура процессора, в которой быстродействие увеличивается за счёт упрощения инструкций, чтобы их декодирование было более простым, а время выполнения — короче. Это также облегчает повышение тактовой частоты и делает более эффективной суперскалярность (распараллеливание инструкций между несколькими исполнительными блоками).
Характерные особенности RISC-процессоров
Фиксированная длина машинных инструкций (например, 32 бита) и простой формат команды.
Специализированные команды для операций с памятью — чтения или записи. Операции вида «прочитать-изменить-записать» отсутствуют. Любые операции «изменить» выполняются только над содержимым регистров.
Большое количество регистров общего назначения (32 и более).
Отсутствие поддержки операций вида «изменить» над укороченными типами данных — байт, 16-битное слово. Так, например, система команд DEC Alpha содержала только операции над 64-битными словами, и требовала разработки и последующего вызова процедур для выполнения операций над байтами, 16- и 32-битными словами.
Отсутствие микропрограмм внутри самого процессора. То, что в CISC-процессоре исполняется микропрограммами, в RISC-процессоре исполняется как обыкновенный (хотя и помещённый в специальное хранилище) машинный код, не отличающийся принципиально от кода ядра ОС и приложений. Так, например, обработка отказов страниц в DEC Alpha и интерпретация таблиц страниц содержалась в так называемом PALCode (Privileged Architecture Library), помещённом в ПЗУ. Заменой PALCode можно было превратить процессор Alpha из 64-битного в 32-битный, а также изменить порядок байтов в слове и формат входов таблиц страниц виртуальной памяти.
49)?